SystemVerilog硬件设计
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内容简介
本书侧重于使用SystemVerilog编写高效的RTL
代码，通过大量示例代码展示如何使用
SystemVerilog进行硬件设计和验证。
全书共分15章，内容包括SystemVerilog中的
常量和数据类型、SystemVerilog的硬件描述、
SystemVerilog中的面向对象编程、SystemVerilog
增强特性、SystemVerilog中的组合逻辑设计、
SystemVerilog中的时序逻辑设计、RTL设计和综合
指南、复杂设计的RTL设计和策略、有限状态机、
SystemVerilog中的端口和接口、验证结构、验证
技术和自动化、 验证结构、验证案例等。
本书适合数字IC验证工程师阅读，也可以作为
高等院校微电子、自动化、电子信息等相关专业师
生的参考用书
作者简介
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